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20 Sep

アウト設計、特性検証、信頼性検証、FPGA設計 評価検証:次世代製品開発のための各種評価データ取得及び解析 ◎LSI設計開発 Verilog/VHDL 論理回路設計・検証 LSI論理回路設計/検証業務 半導体素子のレイアウト設計 ◎半導...

20 Sep
【首都圏/1回面接】半導体テスト開発 ※大手メーカーと長年の取引/在宅勤務〇
Location: 神奈川県川崎市中原区小杉町 - 神奈川県横浜市港北区新横浜
Salary: N/A

言語、Perlスクリプト/MOSトランジスタ/Verilog-HDL ※知識がなくても開発を進めながら習得いただきます 〇使用ツール: アドバンテスト製V93000、テラダイン社製テスタ、その他開発業務に応じたツールを使用 【変更...

20 Sep

ム単位の配属でリーダー経験も積みやすい!】 ■業務内容:プロジェクト例【変更の範囲:会社の定める業務】 CMOSセンサーやチップ、半導体関連の設計・開発・評価、試作業務をお任せします。 <開発言語>VHDL/Verilog/SystemC <使用ツール>Cadence...

20 Sep

不問 <応募資格/応募条件> ■必須条件:下記のいずれかの実績 ・LSI(ASIC/ASSP/FPGA)のデジタル回路設計経験(VerilogやVHDLでの設計・検証経験) ・LSIのインプリ業務(STA) ・LSIのインプリ業務(DFT...

20 Sep

アウト設計、特性検証、信頼性検証、FPGA設計 評価検証:次世代製品開発のための各種評価データ取得及び解析 ◎LSI設計開発 Verilog/VHDL 論理回路設計・検証 LSI論理回路設計/検証業務 半導体素子のレイアウト設計 ◎半導...

20 Sep

,NC-Verilog,VCS,Design Compiler,DFT,PrimeTime,Quatus,Vivado,Virtuoso,Calibre,Spice,Perl,Tcl) ※プレイヤーの採用枠もあります。ご興...

20 Sep

アウト設計、特性検証、信頼性検証、FPGA設計 評価検証:次世代製品開発のための各種評価データ取得及び解析 ◎LSI設計開発 Verilog/VHDL 論理回路設計・検証 LSI論理回路設計/検証業務 半導体素子のレイアウト設計 ◎半導...

20 Sep

学歴>大学院、大学、短期大学、専修・各種学校、高等専門学校、高等学校卒以上 <応募資格/応募条件> ■必須条件: ・電気エンジニアのご経験 ■歓迎条件: ・ユニットやボードの設計経験 ・FPGA<Verilog-HDL言語>の設...

20 Sep

設計 評価検証:次世代製品開発のための各種評価データ取得及び解析 ◎LSI設計開発 Verilog/VHDL 論理回路設計・検証 LSI論理回路設計/検証業務 半導体素子のレイアウト設計 ◎半導体製造プロセス開発 半導...