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06 Dec

プリメンテーションの実施とハード実機の評価業務 ※ご経験スキルに応じて別案件の打診をさせていただく場合もございます。ご面接の際に志向性に合わせて様々お話しできればと思います。 ◆使用ツール: ・verilog/VHDL ・C言語 ・systemVerilog ◆エン...の定める業務 【対象となる方】 <最終学歴>大学院、大学、短期大学、専修・各種学校、高等専門学校、高等学校卒以上 <応募資格/応募条件> ■必須条件: ・Verilog/VHDLの検証経験をお持ちの方 ・画像系・通信...

06 Dec

の定める業務全般 【対象となる方】 <最終学歴>大学院、大学、高等専門学校卒以上 <応募資格/応募条件> ■必須条件: ・Verilog/VHDL 設計経験 ・C/C++ におけるプログラミング経験 ・業界標準のデザインツール、シミ...

06 Dec

年収600万円越/多くの業界に展開することで安定◎/研修費用は売上8%を投資/全社平均残業月19.78H/生涯プロエンジニア〜 ■職務内容: 内視鏡製品のFPGA、Verilogでの回路設計をお任せします。 ■業務の魅力: 先進...

06 Dec

形構造解析経験(特に材料非線形、接触解析) ・制御設計の経験(回路、ソフト) ・回路設計/回路精査/信頼性試験の経験 ・Verilog設計経験 ・解析、実験、評価、試作経験 ・半導体プロセス技術経験...

06 Dec
【本厚木】セルラー向けCIS FW設計検証業務 ◇東証プライム上場G/大手取引多数【EG社】
Location: 神奈川県厚木市愛甲 - 神奈川県厚木市泉町
Salary: N/A

込みソフト開発経験 ・C言語を使用したコーディング ・コミュニケーションスキル ■歓迎条件: ・英語技術文書の読解力 ・アサーション言語(System Verilog アサーション)を使用した検証経験 ・Python、VBA等に...

06 Dec

とりがプロエンジニアとして技術を高め続ける】 ~転職回数多い方も歓迎/業界トップ級!平均年収600万円越/多くの業界に展開することで安定◎/研修費用は売上8%を投資/全社平均残業月19.78H/生涯プロエンジニア~ ■職務内容: 内視鏡製品のFPGA、Verilogでの...

06 Dec

形構造解析経験(特に材料非線形、接触解析) ・制御設計の経験(回路、ソフト) ・回路設計/回路精査/信頼性試験の経験 ・Verilog設計経験 ・解析、実験、評価、試作経験 ・半導体プロセス技術経験...

06 Dec

ルなどのスキルも得ることができます。 【フロントエンド設計/大手システムインテグレーター様】 Verilog-HDLなどのハードウェア記述言語を使用したロジックの設計(論理設計)や、論理検証。またLSIの故障検出率を向上させるための回路挿入や、ゲー...

06 Dec

後は測定及び評価を行い最終顧客に商品を届けるまでの領域をカバーします。 ■担当予定の業務内容: verilog-HDLによる設計および検証(波形目視のほか、リファレンスCによる一致検証、アサーション検証、カバレッジ検証)製造事業所との情報共有、課題発生時の連携など他部署との協業も多いです。設計...資格] <最終学歴>大学院、大学、高等専門学校卒以上 <応募資格/応募条件> ■必須条件: ・半導体のロジック回路設計スキル ※具体的にはVerilog-HDL等の上流設計スキルとSRAM等のメモリを制御する為のロジック回路設計スキル、及び...

06 Dec

資格/応募条件> ■必須条件: ・5年以上のVerilog-RTL設計および検証の経験 ・デジタル回路の仕様策定 ・組み込みSW開発経験/知識 ■歓迎条件: ・SoC/大規模FPGA設計経験 ・高速インターフェイス設計またはIP使用...経験(PCIe,USB,SD,Ether) ■求める実績: ・5年以上のVerilog-RTL設計および検証の経験 ・担当モジュールの責任者の経験 ・自身が担当した上流設計における、上流設計起因でのリメイク発生件数0件...