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04 Dec

ジェクト例【変更の範囲:会社の定める業務】 CMOSセンサーやチップ、半導体関連の設計・開発・評価、試作業務をお任せします。 <開発言語>VHDL/Verilog/SystemC <使用ツール>Cadence(Virtuoso/Incisiveなど...

04 Dec

ットリオーダ制御 ・CCDカメラ評価用画像処理 ・レーザーダイオードドライバ画像制御 ・非同期サンプルレートコンバータIP 他、高速差動通信、PCIe、DDR4、AXIバスなどIP実績も多数 ■開発言語: Verilog-HDL、VHDL、system...-Verilog、system-C、OpenCL、OrCAD、CR-5000他 ■組織構成: 全体50名程度、20代~40代で構成されています。 変更の範囲:本文参照 【チーム/組織構成】 【その他製品・プロジェクト事例】 【利用...

04 Dec

システム用セキュリティ機器の設計、要素技術開発、ソフトウェア設計 ・デジタル回路設計(RTL設計)、SoC設計など ※使用言語、環境、ツール、資格等…C/C++、Java、HDL(Verilog、SystemVerilog)、Python等|Linuxの通...

04 Dec

セス構築における ・クルマとしての性能目標値に基づく、SoCの要求仕様書の作成 ・AI評価とSoC最適化仕様の検討、実設計と検証 ・完成したSoCの機能評価/プロセスの構築 【変更の範囲:会社の定める業務】 【開発ツール】 RTL(Verilog...

04 Dec

機器のアーキテクチャ設計(ASIC設計・FPGA設計等)をお任せします。 【使用言語】Verilogなど ■開発詳細 ・開発するアプリケーションのテーマは、「高速通信」「画像処理」「符号化/複合化」「人工知能/AI」などです、 ※XtensaやASIPなど...

04 Dec

ジメントの向上に更なるチャレンジを求める方を歓迎しますので、 ご興味のある方は是非ともご応募ください。 <下記応募資格/応募条件記載以外で、活かせる経験は以下の通りです。> ツール使用経験: SystemVerilog/Verilog-HDL/VHDL SVA/PSL/UVM Xcelium...

04 Dec

環境 【言語】C、C++、C#、Java、Python、VHDL、Verilog等 【OS】Linux、Android、iOS、μITRON、RIOT、Windows、T-Kernel 【構成管理ツール】Git、GitLab、GitHub...

04 Dec

環境 【言語】C、C++、C#、Java、Python、VHDL、Verilog等 【OS】Linux、Android、iOS、μITRON、RIOT、Windows、T-Kernel 【構成管理ツール】Git、GitLab、GitHub...

04 Dec

セス構築における ・クルマとしての性能目標値に基づく、SoCの要求仕様書の作成 ・AI評価とSoC最適化仕様の検討、実設計と検証 ・完成したSoCの機能評価/プロセスの構築 【変更の範囲:会社の定める業務】 【開発ツール】 RTL(Verilog...

04 Dec

ファイル作成等) ◇FPGA インプリメント ◇実機評価サポート ※ご経験スキルに応じて別案件の打診をさせていただく場合もございます。ご面接の際に志向性に合わせて様々お話しできればと思います。 ◆使用ツール: 設計言語:Verilog 使用...